来源:互联网 更新时间:2026-05-08 17:32
5月8日消息,据报道,

为此,三星考虑借鉴NAND闪存的设计,把负责读写操作的控制电路置于存储阵列下方。在2026年VLSI研讨会上,三星将展示其16层垂直堆叠DRAM方案,该方案采用GAA晶体管和水平放置的存储电容器。

SK海力士此前已在IEEE VLSI Symposium 2025上公布该技术路线图,其4F²垂直栅极平台旨在实现高密度、高速和低功耗三大目标。该公司还在该会议上展示了垂直栅极DRAM的电性特性验证结果。
据业界消息,三星内部已制定在第7代1d nm后导入垂直通道晶体管技术的路线图,相关产品有望最早于2至3年内面世。SK海力士方面规划垂直结构DRAM(含4F²架构)将在3年内进入量产阶段,与三星在时间线上形成直接竞争。

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