就是换个名字？华为逻辑折叠和3D封装到底有何区别：根本不是一个东西

5月27日，

，它将原本平铺在二维平面上的电路，通过三维立体折叠和垂直互连"堆叠"起来，使关键路径走线长度缩短50%-80%，大幅降低了信号传播的RC负载。

官方实测显示，相比麒麟9030 pro，麒麟2026的晶体管密度大幅提升了53.5%，达到了的238MTr/平方毫米，这意味着每平方毫米的芯片面积上，可以集成2.38亿个晶体管，理论上与Intel 18A工艺持平，接近初代台积电3nm。

消息公布后，很多人认为，

对此，专家表示，

简单来说，

从底层原理看，前者是在制造后期尽可能让不同芯片贴得更近，后者则是在设计图纸阶段就从根本上缩短了信号的物理传输距离。

两者最核心的区别在于，

这也意味着，

。二者处于完全不同的技术抽象层级，解决的是不同维度的问题，是互补而非替代的关系。

具体来看，我们熟知的2.5D封装（以台积电CoWoS为代表），是在硅中介层上将多颗独立流片的die横向并排摆放，再通过中介层实现高带宽互联， HBM超高速显存+GPU组合就是最典型的案例，HBM 和GPU本身是两颗物理完全分离的芯片。而3D封装（如Intel Foveros技术）则更进一步，通过硅通孔（TSV）技术将多颗独立die垂直堆叠在一起。

。它将原本平铺在同一个有源层上的所有逻辑门电路，按照关键信号的传输路径，重新分配到两个甚至多个垂直堆叠的有源层中，层间信号通过间距仅1.5微米的极短TSV直接穿越，这个距离远小于die间封装的TSV间距。这是一项设计工具层面的创新，而非制造工艺层面的突破。

值得注意的是，

这一进步，在传统摩尔定律的演进路径下，需要整整两个制程节点的迭代才能完成，耗时大约3年。